数电试验计数器电路VIP专享VIP免费

实验5计数器实验电路1实验目的1.1掌握计数器的工作原理及特性1.2采用触发器及集成计数器构成任意进制计数器2实验仪器与元器件2.1实验仪器数字电路实验箱、数字万用表、示波器2.2芯片74LS00/74ls0474LS4874LS161共阴数码管电位器电阻等其它元件若干3预习要求3.1预习计数器相关内容。3.2作出预习报告。4实验原理计数器是用来实现计数功能的时序部件,它能够计脉冲数,还可以实现定时、分频、产生节拍脉冲和脉冲序列等。计数器的种类很多，按时钟脉冲输入方式的不同，可以分为同步计数器和异步计数器。按进位体制不同，可以分二进制和非二进制计数器。按计数的增减趋势，可分加法或减法计数器等。目前，无论是TTL还是CMOC集成电路，都有品种齐全的中规模集成计数电路。作为使用者可以借助器件手册提供的功能表和工作波形以及引脚分布图，就能正确地使用这些器件。4.1异步计数器异步计数器是指计数脉冲不是直接加到所有触发器的时钟脉冲端。这样，当一个计数脉冲作用后，计数器中某些触发器的状态发生变化，而其它触发器保持原来状态，即计数器中各触发器状态的更新与输入时钟脉冲异步。在设计模为整数N的异步计数器时，如果KN2，则为二进制计数器，例如设计一个4位二进制计数器，1624N，K=4，用4个触发器级联即可。如果N不等于2的整次幂，则是非二进制计数器，这时，可将N写N=1*2NK其中1N为奇数,这样由模为K2和模为1N的两个计算器级联而成,其中模为1N的计数器通常用反馈的方法构成.例如设计一个异步十进制计数器,可令K2=12,1N=5,就是用一个模2计数器和一个模5计数器级联.图7.1所示集成触发器74LS74构成的异步十六进制四位加法计数器.联接特点是将各个触发器的Q与该触发器的D输入端连接,就把每个D触发器接成T触发器,再由低位触发器的Q端和高一位的CP端相连接而成。4.2同步计数器为了提高计数的速度，可采用同步计数器，所谓同步就是计数脉冲同时连接在各位触发器的时钟脉冲输入端，当计数脉冲来到时，应该翻转的触发器在同一时刻翻转。因此，同步计数器的工作速度比异步计数器快。同步计数器的设计可按“状态表+卡诺图+写出各触发器控制输入端的逻辑方程”，进行，然后画出逻辑电路。也可以根据状态表中各触发器输出的变化规律，直接写出各触发器控制输SDRDQ0Q1Q2Q3图7.1四位二进制异步加法计数器入端的逻辑方程，最后画出逻辑电路图。例如设计一个同步十进制加法计数器，其状态转换表如表7.1所示。采用双JK触发器74LS76，通过分析状态转换表，可得到各触发器控制输入端的逻辑方程如下。表6.1十进制加法计数器状态转换表计数脉冲数二进制数100000001020001001013001000112400110100350100010146010101105701100111680111100079100010018100100009（1）第一位触发器0Q，每来一个时钟脉冲CP，其状态翻转一次，则100KJ。（2）第二位触发器1Q，在10Q时，来一个时钟脉冲CP，其状态翻转一次，而在13Q时不翻转，故301QQJ，.01QK。（3）第三位触发器2Q，在时再来一个101QQ时钟脉冲CP其状态就翻转，故0122QQKJ。（4）第四位触发器3Q，在1012QQQ时，再来一个钟脉冲CP其状态就翻转，并在第十个CP触发后，3Q应由1翻转为0，故0123QQQJ，03QK。由此画出的逻辑电路如图7.2所示。4.3集成计数器实际工作中,人们很少使用中、小规模触发器构成各种计数器，而是直接选用集成电路计数器产品。集成计数器的类型很多，例如有:LS/HC系列和CMOS序列的2×5进制异步计数器74LS90、74LS390（双2×5），2×6进制异步计数器74LS92，可预置同步4位二进制计数器74LS161/C40161，可预置双时钟同步可逆BCD计数器74LS192/C40192等。下面介绍集成计数器74LS161。（1）集成计数器74LS16174LS161是4位二进制同步加计数器。图7.3是它的引脚分布图，其中RD是异步清零端，LD是预置数控制端，A、B、C、D是预置数据输入端，EP和ET是计数使能（控制）端，RCO（DCBAQQQETQ）是进位输出端，它的设置为多片集成计数器的级联提供了方便。它的逻辑功能见表6.2表6.274LS161的功能表清零RD预置LD使能EPET时钟预置数据输入ABCD输出QAQBQCQDL××××××××LLLL图7.2同步十进制加法计数器图7.3集成计数器74161引脚图VccRCOQAQBQCQDETLD74LS74R...